主从边沿触发寄存器

主从结构是构成边沿触发触发最常见的方法。存器由一个负锁存器 (主级) 串联一个正锁存器 (从级) 构成。本例采用的是多路开关型锁存器, 但实际上可以采用任何类型的锁存器。

主级是负锁存器，从级是正锁存器。这样就能实现正沿触发效应。负沿触发交换两个锁存器的位置即可实现。在低电平的时候，

工作流程

上图是一个完整的主从正沿触发寄存器的晶体管级实现。多路开关采用上一节讨论过的传输门来实现。当时钟处于低电平时 ( 导通 关断，输入 被采样到节点 上。在此期间， 和 分别关断和导通。交叉耦合的反相器 ( 保持从锁存器的状态。当时钟上升到高电平时，主级停止采样输人并进人维持状态。 关断 导通，交叉耦合的反相器 和 保持 状态。同时， 导通 关断， 被复制到输出 上。

有点繁复，简化一点就是，低电平时主级透明，从级维持；上升沿时，主级高电平主级维持，从级透明。

[! question] 这里我没有讨论上升沿和下降沿的情况，虽说说明了是上升沿寄存器，但是还是没有理得很清楚。

时序特性

寄存器有三个重要的特征时序参数: 建立时间、维持时间和传播延时。

假设每一个反相器的传播延时为 , 传输门的传播延时为 ，同时假设污染延时为0，而且由 产生 的反相器的延时也为0。

对上面这个电路来分析寄存器的三个时序参数。

建立时间是输入数据 D 在时钟上升沿之前必须有效的时间。否则在时钟上升沿时，从级无法采样到信号 D。当信号为低电平时，主级透明，信号 D 需要传到 ，并且使得 两端信号相同以避免 和 出错。由此可得建立时间为，